TSMC 3DFabric von TSMC - wie der Packaging-Baukasten Highend-Chips beschleunigt

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TSMC 3DFabric klingt trocken, aber wer im Reinraum neben einem mit CoWoS verpackten KI-Chip steht, hoert das leise Surren der Teststation und sieht Millimeter-grosse Silizium-Module, die Rechenzentren spuerbar schneller machen. TSMC 3DFabric ist TSMCs Baukasten fuer fortgeschrittenes 3D-Packaging, der Logik, Speicher und Chiplets dicht aufeinanderstapelt. Fuer Entwickler fuehlt es sich an wie ein Lego-Set aus Silizium, mit dem sich neue Systemarchitekturen zusammenstecken lassen.

Was hinter TSMC 3DFabric steckt

TSMC 3DFabric ist der Sammelbegriff fuer TSMCs fortgeschrittene Packaging-Technologien wie CoWoS, InFO, SoIC und 3D Fabric-Integration, die Logik- und Speicherchips auf einem Interposer oder direkt uebereinander verbinden. Die Taiwaner beschreiben 3DFabric als durchgaengigen Design- und Fertigungs-Flow von Frontend-Waferfertigung bis zu Backend-Test und -Verpackung. Ziel ist, Hochleistungs-Systeme mit hoher Bandbreite, geringerer Latenz und besserer Energieeffizienz zu bauen, ohne nur ueber kleinere Strukturbreiten gehen zu muessen.

CoWoS (Chip-on-Wafer-on-Substrate) ermoeglicht dabei grosse 2.5D-Module mit mehreren Dies auf einem Silizium-Interposer, waehrend SoIC echte 3D-Stacking-Verbindungen zwischen Wafern und Dies bereitstellt. InFO adressiert hingegen flache, luefterlose Designs etwa fuer Mobil-SoCs, bei denen ein organischer Trager entfaellt und der Chip besonders duenn wird. Gemeinsam bilden diese Varianten ein flexibles Portfolio, mit dem Kunden vom Smartphone bis zum Supercomputer abgedeckt werden.

Warum CoWoS und SoIC fuer KI-Systeme wichtig sind

Im KI-Boom sind vor allem CoWoS-Module zum Engpass geworden, weil Anbieter wie Nvidia, AMD oder Broadcom ihre schnellsten Beschleuniger auf solchen Multi-Chip-Paketen aufbauen. Laut TSMC soll die CoWoS-Kapazitaet 2024 und 2025 deutlich erhoeht werden, um die starke Nachfrage nach KI-Beschleunigern zu bedienen. Dabei ermoeglicht CoWoS eine extrem breite Speicheranbindung mit mehreren HBM-Stacks, was die Bandbreitenanforderungen grosser Sprachmodelle besser bedient als konventionelle Packages.

SoIC geht einen Schritt weiter und stapelt Logikchips direkt aufeinander, verbunden ueber Through-Silicon-Vias oder hybride Bumps. Das senkt die Entfernung zwischen Recheneinheiten, verringert Signallaufzeiten und kann die Leistungsaufnahme fuer bestimmte Workloads senken. Fuer Entwickler heisst das: Statt einen Monolithen zu designen, lassen sich Funktionsbloecke modular als Chiplets kombinieren und in der Vertikalen verbinden.

Ein Blick in die Fertigungshalle

Wenn TSMC-Chef C.C. Wei ueber 3DFabric spricht, betont er regelmaessig, dass Packaging laengst ein strategischer Kern des Geschaefts sei und nicht mehr nur ein nachgelagerter Schritt. In den Fertigungshallen in Zhunan und Taichung arbeiten spezialisierte Teams daran, Wafer zu schleifen, zu stapeln und hauchduenne Interposer exakt auszurichten. Wer hier durch das Beobachtungsfenster schaut, sieht Roboterarme, die wie geduldige Haende winzige Dies aufnehmen und auf Tragersubstrate setzen.

Die thermische Herausforderung ist enorm, denn mehrere aktive Chips in einem Package erzeugen mehr Waerme auf engem Raum. TSMC entwickelt deshalb angepasste Heatspreader, Underfill-Materialien und Testverfahren, um Hotspots zu identifizieren und abzufangen. Fuer Kunden heisst das, dass sie Waermebudget und Leistungsziele frueh im Design-Flow mit TSMC-Ingenieuren abstimmen muessen.

Stellenwert im TSMC-Portfolio und Kundensicht

3DFabric ist eng an die fuehrenden Prozessknoten wie N5, N3 und die kommenden N2-Generationen gekoppelt und wird in Roadmaps von Hyperscalern und Chipdesignern explizit eingeplant. Grosskunden buchen Kapazitaet fuer CoWoS und SoIC oft Jahre im Voraus, weil der Ausbau von Packaging-Linien Milliarden-Investitionen erfordert. Laut TSMC sollen die Einnahmen aus Advanced Packaging in den kommenden Jahren ueberproportional wachsen, getragen von KI- und HPC-Anwendungen.

Aus Sicht von Entwicklern eroeffnet 3DFabric die Option, heterogene Systeme zu bauen, bei denen etwa CPU, GPU, Beschleuniger und HBM in einem einzigen Package kombiniert werden. Diese Architektur ermoeglicht es, Datenbewegungen aus dem Mainboard heraus ins Package zu ziehen und so Bottlenecks beim Speicherzugriff zu entschärfen. Gleichzeitig bleibt die Flexibilitaet erhalten, einzelne Chiplets in kuerzeren Zyklen zu aktualisieren.

Kontext und Aktienbezug

TSMC verankert 3DFabric als Schluesselbaustein, um den KI-Boom auf der Wertschöpfungsstufe Packaging auszunutzen und Kunden eng an die eigenen Fertigungs- und Designservices zu binden. Die Taiwan Semiconductor Aktie (ISIN TW0002330008) notiert an der Taiwan Stock Exchange und ueber ADRs an der NYSE, wobei Anleger die hohe Nachfrage nach 3D-Packaging und KI-Chips aufmerksam verfolgen.

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